WEKO3
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三段NANDゲート回路の論理設計法について(II) : P-N項法の改良
https://doi.org/10.15099/00004452
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名前 / ファイル | ライセンス | アクション |
---|---|---|
Kokiyo_44_01_Page031to040.pdf (1.6 MB)
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|
Item type | 紀要論文 / Departmental Bulletin Paper(1) | |||||
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公開日 | 2012-10-12 | |||||
タイトル | ||||||
タイトル | 三段NANDゲート回路の論理設計法について(II) : P-N項法の改良 | |||||
言語 | ||||||
言語 | jpn | |||||
キーワード | ||||||
主題Scheme | Other | |||||
主題 | 三段NANDゲート回路 | |||||
キーワード | ||||||
主題Scheme | Other | |||||
主題 | 論理設計法 | |||||
キーワード | ||||||
主題Scheme | Other | |||||
主題 | P-N項法 | |||||
キーワード | ||||||
主題Scheme | Other | |||||
主題 | NANDゲート回路 | |||||
キーワード | ||||||
主題Scheme | Other | |||||
主題 | プログラム化 | |||||
キーワード | ||||||
主題Scheme | Other | |||||
主題 | プログラム | |||||
資源タイプ | ||||||
資源タイプ識別子 | http://purl.org/coar/resource_type/c_6501 | |||||
資源タイプ | departmental bulletin paper | |||||
ID登録 | ||||||
ID登録 | 10.15099/00004452 | |||||
ID登録タイプ | JaLC | |||||
著者 |
宮越, 隆
× 宮越, 隆× 松田, 秀雄× 大澤, 一人× 畠山, 豊正 |
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著者別名 | ||||||
姓名 | Miyagoshi, Takashi | |||||
著者別名 | ||||||
姓名 | Matsuda, Hideo | |||||
著者別名 | ||||||
姓名 | Oosawa, Kazuto | |||||
著者別名 | ||||||
姓名 | Hatakeyama, Toyomasa | |||||
その他(別言語等)のタイトル | ||||||
その他のタイトル | The Logical Design of Minimal Three-level NAND Circuits(II) : The Improvement of P-N Cube Method | |||||
抄録 | ||||||
内容記述タイプ | Abstract | |||||
内容記述 | We presented the P-N cube method for the synthesis of minimal NAND circuits in the previous paper of this publication. The method does not provide necessarily a optimum circuit as it realizes any function with three-level NAND circuit. A catalog of minimal three-variable NAND circuits has been given by Hellerman. Our synthesis circuits are compared with that catalog and the way of improving our circuits which are in disagreement with the minimal circuit is shown. It is described that if we present the function with a term representation for computer program, whereas we present it with the truth table in the previous method, the improved method becomes to be able to apply to NAND circuits of a large number of variables. It is also shown that our improved method produces the minimal circuit in shorter computing time than the other method reported recently. | |||||
抄録 | ||||||
内容記述タイプ | Abstract | |||||
内容記述 | 我々は本紀要の前論文で最小NANDゲート回路の設計法として,P-N項法を提案した。 本方法はどのような関数も三段NANDゲート回路として実現するので,必ずしも最適回路とはいえない。 3変数のNANDゲート回路の最小回路はへラーマンによって与えられている。 我々の合成した回路がカタログと照らし合わされ,最小回路と一致しなかった回路を改善する方法が示されている。 もし,関数を前の手法のように真理値ではなく,項表現で表すならば多変数のNANDゲート回路に適用できるようになるということが述べられる。 改良した本方法が最近発表された他の方法より短い計算時間で最小回路が求められることも示される。 |
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引用 | ||||||
内容記述タイプ | Other | |||||
内容記述 | 富山大学工学部紀要,44, Page 31-40 | |||||
書誌情報 |
富山大学工学部紀要 巻 44, p. 31-40, 発行日 1993-03 |
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ISSN | ||||||
収録物識別子タイプ | ISSN | |||||
収録物識別子 | 03871339 | |||||
書誌レコードID | ||||||
収録物識別子タイプ | NCID | |||||
収録物識別子 | AN00175872 | |||||
著者版フラグ | ||||||
出版タイプ | VoR | |||||
出版タイプResource | http://purl.org/coar/version/c_970fb48d4fbd8a85 | |||||
国立国会図書館分類 | ||||||
主題Scheme | NDLC | |||||
主題 | ZM2 | |||||
出版者 | ||||||
出版者 | 富山大学工学部 | |||||
資源タイプ(DSpace) | ||||||
内容記述タイプ | Other | |||||
内容記述 | Article |